Verilog使用方法介绍
此项目是Verilog使用方法介绍，Verilog是一种硬件描述语言（HDL）。硬件描述语言是用于描述数字系统的语言：例如，网络交换机，微处理器或存储器或简单触发器。
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应用介绍
// D flip-flop Code
module d_ff ( d, clk, q, q_bar);
input d ,clk;
output q, q_bar;
wire d ,clk;
reg q, q_bar;
always @ (posedge clk)
begin
q <= d;
q_bar <= !d;
end
endmodule
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| 名称 | 大小 | 修改日期 |
|---|---|---|
| Verilog使用方法介绍.txt | 0.15 KB | 2020-03-08 |
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