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verilog实现串口功能

内核的主要代码位于rtl子目录中。 uart_rx.v和uart_tx.v文件是实际的实现，uart.v只是实例化这两个模块并建立了两个内部连接。 UART发送器和接收器均使用单个发送或接收引脚。这些模块采用一个参数DATA_WIDTH，该参数指定数据总线的宽度和通信的实际数据字的长度。 8位接口的默认值为8。

2020-06-10

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verilog_hdl语法和语义

此项目是Verilog HDL语法和语义。做了空格示列、评论示列、名称的示列、转义标识符示例等等。

2020-03-08

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开发平台: windows,linux

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Verilog运算符

此项目是Verilog运算符。包括了算术运算符、关系运算符、逻辑运算符、按位运算符、串联运算符等等。也介绍了二进制、整数除法、模运算等等。想了解更详细请点击下方链接下载即可。

2020-03-08

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开发平台: windows,linux

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以太网芯片设计代码

以太网芯片设计，10g模块，arp模块，时钟模块，IP帧发送器。IP模块， 1206/5000 以太网相关组件的集合，用于千兆位，10G和25G数据包处理（8位和64位数据路径）。包括用于处理以太网帧以及IP，UDP和ARP的模块，以及用于构建完整UDP / IP堆栈的组件。包括用于千兆位和10G / 25G的MAC模块

2020-06-10

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开发平台: windows,linux

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Verilog PLI范例

此项目是Verilog PLI范例。本人展示了C代码和Verilog代码，希望能够给您带来收获。

2020-03-08

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开发平台: windows,linux

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Verilog工具

此项目全面的介绍了Verilog工具。仿真工具：Verilog-XL、NCVerilog、VCS、Finsim、Aldec、Modelsim、Smash、Silos、Veritak、MPSim、VeriLogger Extreme。免费仿真工具：Icarus Verilog、Verilator、Cver、Verilogger、Veriwell。VCD检视器：Waview、nWave、Undertow。代码调试工具、实时工具。想了解更详细的请点击下方下载，附件更详细的说明。

2020-03-11

100
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开发平台: windows,linux

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